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PVD · CVD · ALD · ECDAbscheidetechnologien
1nm–100μmSchichtdickenbereich
100mm–300mmWafer-Durchmesser
Metal · Dielectric · PolymerMaterialklassen

Übersicht

Dünnschichtabscheidung ist die Grundlage der Halbleiterfertigung.

PVD, CVD, ALD, ECD. ISO-Klasse-5-Reinraum. Schichtdickenkontrolle < 1 nm.

Abscheidungstechnologien

Physikalische Gasphasenabscheidung (PVD)

Sputter- und Verdampfungsprozesse für Metalle, Legierungen und dielektrische Schichten auf 100-mm- bis 300-mm-Wafern. DC/RF-Magnetron-Sputtern, Elektronenstrahl- und thermische Verdampfung decken das gesamte Spektrum an Leiter- und Isolatormaterialien für Verbindungs- und optische Schichtstapel ab.

DC/RF Magnetron SputteringE-beam EvaporationThermal EvaporationReactive SputteringCo-sputtering (alloys)Wafer: 100mm–300mm

Chemische Gasphasenabscheidung (CVD)

LPCVD-, PECVD- und MOCVD-Prozesse scheiden konforme Oxid-, Nitrid-, Polysilizium- und III-V-Epitaxieschichten über einen weiten Temperaturbereich ab. Die ausgezeichnete Stufenbedeckung macht CVD zur Standardwahl für Struktur- und Passivierungsschichten in der MEMS- und IC-Fertigung.

LPCVD: Si₃N₄, Poly-Si, TEOS-SiO₂PECVD: SiO₂, SiNx, SiON, a-SiMOCVD: III-V epi layersDeposition Temp: 250–900°CStep coverage > 95% (LPCVD)Wafer: 100mm–300mm

Atomlagenabscheidung (ALD)

Selbstlimitierende Oberflächenreaktionen scheiden ultradünne, pinholefreie dielektrische und metallische Schichten mit Subnanometer-Dickenkontrolle ab. Ideal für High-k-Gate-Dielektrika, Diffusionsbarrieren und konforme Beschichtung von Strukturen mit hohem Aspektverhältnis.

Al₂O₃, HfO₂, ZrO₂, TiO₂, Ta₂O₅AlN, TiN, Pt, Ru (metals)Thickness: 1nm–200nmUniformity: < 1% (1σ)Thermal & Plasma-Enhanced ALDWafer: 100mm–300mm

Elektrochemische Abscheidung (ECD)

Galvanische Abscheidung von Cu, Ni, Au, Sn und Ag für Verbindungen, TSV-Füllung und UBM-Stapel. Kupfer-TSV-Füllung mit hohem Aspektverhältnis und stromlose Ni/Au-Pad-Metallisierung unterstützen fortschrittliche Verpackung und MEMS-Anwendungen.

Cu, Ni, Au, Sn, AgCu TSV fill (AR 10:1)Ni/Au UBM stacksElectroless Ni(P)/AuThickness: 0.1μm–100μmWafer: 100mm–300mm

Polymer- & Spin-On-Dielektrika

Spin-beschichtete SOG-, BCB-, Polyimid- und SU-8-Schichten bieten spannungsarme dielektrische Isolation, Planarisierung und dicke Strukturschichten. Geeignet für Redistribution-Layer, MEMS-Strukturelemente und flexible Geräteanwendungen.

SOG (silicate, siloxane)BCB (Cyclotene™)Polyimide (HD, PS, Photo-definable)SU-8 (MEMS structural)Thickness: 50nm–200μmWafer: 100mm–300mm

Filmmaterialien

Oxide & Dielektrika

SiO₂ · Al₂O₃ · HfO₂ · Si₃N₄ · Ta₂O₅

Metalle

Al · Ti · Cr · Ni · Pt · Au · Cu · W · Mo

Transparente leitfähige Oxide

ITO · AZO · FTO

Harte & verschleißfeste Beschichtungen

DLC · TiN · CrN

Polymere & organische Materialien

Parylene · Polyimide · BCB · SU-8

Piezoelektrische & ferroelektrische Materialien

AlN · ZnO · PZT

Qualitätskennzahlen

ParameterZielwertMessmethode
SchichthaftungBesteht ASTM-D3359-GitterschnitttestGitterschnitt-Klebebandtest
Pinhole-Dichte< 0,1 Pinholes/cm² (nach Abscheidung)Nassätz-Dekoration + optische Inspektion
Stufenbedeckung (Konformität)> 80 % bei Aspektverhältnis 5:1Querschnitts-REM
Spannungswiederholbarkeit (Charge zu Charge)± 10 MPa (3σ)Wafer-Krümmung (Stoney-Gleichung)
Metallische Kontamination< 5×10¹⁰ Atome/cm² (TXRF)TXRF-Analyse
Haftung nach TemperaturwechselnKeine Delamination nach 500 Zyklen (−55 °C bis 125 °C)Thermoschockkammer + Klebebandtest
Dickenwiederholbarkeit (Los zu Los)± 1,5 % (3σ)SPC-Regelkarte (Ellipsometrie)
Wafer-Bow-Änderung nach Abscheidung< 25 μm (200 mm), < 40 μm (300 mm)Kapazitive Messung / Interferometrie

Typische Anwendungen

MEMS Struktur- & Opferschichten

Poly-Si, SiO₂, Si₃N₄ für MEMS-Strukturen.

Optische Beschichtungen & Photonik

AR-, HR-Beschichtungen. ITO. DBR-Spiegel.

CMOS/IC Back-End-Metallisierung

Al, Ti/TiN, Cu-Saat, Ta/TaN, Ni/Au.

Passivierung & Verkapselung

Passivierung: Si₃N₄, Parylen, ALD Al₂O₃.

Piezoelektrische Schichten

AlN, ZnO, PZT für Piezo-Anwendungen.

Dünnschichtwiderstände

NiCr, TaN, Pt Widerstände und Heizer.

Mehrschichtstapel

Unsere Mehrschichtabscheidung ermöglicht komplexe Dünnschichtstapel mit präziser Dickenkontrolle. Jede Schicht wird sequenziell mit In-situ-Überwachung abgeschieden, was die Haftung zwischen den Schichten und die Grenzflächenqualität sicherstellt.

Substratkompatibilität

Unsere Aufbereitungsprozesse unterstützen Siliziumwafer aller gängigen Dotierungstypen, Orientierungen und Durchmesser. Wir bieten außerdem die Aufbereitung von SOI-, Glas- und Verbundhalbleitersubstraten mit dedizierten Prozesschemien für jedes Materialsystem an.

Qualitätssicherung

Schichtspannungskontrolle < 50 MPa. Brechungsindextoleranz ±0,005.

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ISO 9001 zertifiziert SEMI-T7-konform Messtechnik-Ausrüstung Losrückverfolgbarkeit